AD19 PCB板完整绘制过程
1、完整原理图导入
一个项目的绘制电路原理图完成后,我们需要在Design选项下Update PCB Document xxxx.PcbDoC 。
Fig 1
在更新的过程过程中,当Report Changes…时会出现很多错误,需要我们进行改正(可以点击Only Show Errors,只显示错误),例如
Fig 2
Massage中的信息会告诉我们错误的原因,对于Unknown Pin这类错误,一般有下面几点原因:(1)原理图元件没有添加封装;(2)原理图和封装引脚数个数不一致;(3)原理图引脚和封装的引脚代表字符不匹配(原理图的引脚是数字1,2,3…,而封装是字母A,B,C…),因此我们需要查看我们的封装和原理图,问题解决后,在信息栏是没有显示错误的(导入之后存在报错,取消不常用的DRC检测选项,DRC检查选项过多导致PCB设计布局布线的时候存在卡顿现象,可以只剩下电气性能的检查选项)。
Fig 3
成功导入PCB后,可以在Tools中Component Placement选择适合自己的完整排列方式,在此次排版中选择Arrange Within Rectangle,最终的形式是这样的。
Fig 4
但是绘制会出现图4这种情况(芯片引脚会有很多绿色的叉,标注引脚间距小于10mil),有些博主的解决办法是在Design中Rules做修改,将Design Rules中的Silk to Silk Clearance和Silk To Solder Mask Clearance取消勾选,但是问题并没有得到解决,最后通过查阅资料,发现在Electrical下Clearance中选择将Ignore pad to pad clearances within a footprint勾选,这种问题就会解决。
Fig 5
2、过程叠层设置
然后进行叠层设置,在Design中选择Layer Stack Manager…。完整点击Top Layer右键选择Plane,添加中间层,添加成功以后,命名是绘制按照自己的习惯进行设置,为了降低平面边缘的辐射效应,在电源层和地层间要尽量满足20mil原则,因此点击Pullback distance,右键弹出Select columns,将里面的Pullback distance选项设置为可见并确定退出 。继续在Properties中将自己命名的过程中间层的Pullback distance设置为2-3倍关系(电源层和地线层) 。
Fig 6
设置完成后,我们可以看到会有自己命名的完整层。
Fig 7
3、绘制封装间隙设置
有时候,导入的过程PCB会出现以下这种情况
Fig 8
对于这种情况是因为元件封装的间距小于10mil,但是在工程中设置的是10mil,因此需要在Design中的Rules做修改,如图所示 。
Fig 9
将Minimum Clearance改成<10mil即可。完整
4、绘制板框的过程设置和定位孔的放置
设置板框的绘制,具体方法在本人的其他文章中有介绍,大家可以参考,这里不做过多的介绍(这里做个说明:尺寸标注一般是在Mechanical中标注)。
5 、交互式布局
交互式布局可以达到原理图和PCB两两交互,需要在原理图编辑界面和PCB设计交互界面都执行菜单命令(Tools-Cross Select Mode),激活交叉选择模式。
6 、模块化布局
对于布局,一般都是按照一定的设计要求进行布局,可以根据信号飞线和先大后小的原则进行大致位置的放置,然后将小元件放置在大元器件的附近 。
6.1、布局原则
(1)滤波电容靠近IC管脚放置,BGA滤波电容放置在BGA背面管脚处。
(2)元件布局要均匀,疏密得体。
(3)电源模块和其他的模块有一定的距离,放置干扰 。
(4)布局考虑布线的就近原则,布线不能太长。
(5)PCB布局布线是一件雕刻艺术品的过程。
7、类创建和PCB规则设置
为了区分信号,通常将同一属性的网络或者元件或者层或者差分放置在一起构成一个类别 。在Design-Classes(快捷键D+C)中设置类(十大类:常见的是网格类和差分类),可以在Net Classes下新建各种类 。
Fig 10
在新建类可以命名,然后将Non-Members进行归类 。
Fig 11
归的类可以设置不同的颜色,可以点击PCB框界面左下角的PCB选项设置 。
Fig 12
类的颜色或者是点击右下角的Panels进行设置 。选中类右键弹出的Change Net Color 。
8、PCB规则设置
8.1间距设置
在Design下选择Rules,进入规则编辑框(快捷键D+R),在Design Rules-Electrical-Clearance下新建间距规则,命名自己可以设置,默认All,规则4.5mil,其中Copper和其他元素之间的距离要求为10mil。
Fig 13
8.2线宽规则设置
根据规定,4层板内电层添加的是负电层,负电层只是用来作为PWR或者GND层分割之用,,因此不需要显示这内层的走线线宽规则,仅仅是关注TOP和BOTTOM层的走线规则,最大值 、最小值和最佳值都是5.5mil。
Fig 14
然后再创建一个PWR类的线宽规则,最小值